| 1. | |
강의소개 | 1. 담당교수 소개 2. 강의 소개 3. 수업진행 방법 4. 교재 소개 5. 주차별 교육내용 6. 학습평가 |
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들어가기 | 1. 디지털과 아날로그 2. 디지털 정보의 표현 3. 논리레벨과 펄스 파형 4. 디지털 집적회로 5. ADC와 DAC |
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| 2. | |
수의 체계 | 1. 10진수 2. 2진수 3. 8진수와 16진수 4. 진법 변환 5. 2진 정수 연산과 보수 6. 2진 부동소수점수의 표현 |
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디지털논리회로 | 1. 논리 레벨 2. NOT 게이트와 버퍼 게이트 3. AND 게이트 4. OR 게이트 5. NAND 게이트 6. NOR 게이트 7. XOR 게이트 8. XNOR 게이트 9. 정논리와 부논리 |
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| 3. | |
논리회로 | 1. 기본 논리식의 표현 2. 불 대수 법칙 3. 논리회로의 논리식 변환 4. 논리식의 회로구성 |
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논리회로 | 5. 불 대수식의 표현 형태 6. 불 대수 법칙을 이용한 논리식의 간소화 |
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| 4. | |
논리식의 간략화 - 1 | 1. 2변수 카르노 맵 2. 3변수 카르노 맵 |
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논리식의 간략화 - 2 | 3. 4변수 카르노 맵 4. 선택적 카르노 맵 5. 논리식을 카르노 맵으로 작성 6. 5변수, 6변수 카르노 맵 |
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| 5. | |
플립플롭(Flip-Flop) - 1 | 1. 기본적인 플립플롭 2. S-R 플립플롭 |
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플립플롭(Flip-Flop) - 2 | 3. D 플립플롭 4. J-K 플립플롭 |
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| 6. | |
플립플롭(Flip-Flop) - 3 | 5. T 플립플롭 6. 비동기 입력 |
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동기순서논리회로 - 1 | 1. 동기 순서논리회로 개요 2. 동기 순서논리회로의 해석 과정 |
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| 7. | |
동기순서논리회로 - 2 | 3. 플립플롭의 여기표 4. 동기 순서논리회로의 설계 과정 |
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동기순서논리회로 - 3 | 5. 동기 순서논리회로의 설계 예 6. 미사용 상태의 설계 |
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| 8. | |
비동기 카운터 | 비동기 카운터 | |
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동기 카운터 | 동기 카운터 | |
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설계과제를 위한 제작도구 및 구형파 발생기 | 1. 제작도구 2. 부품외향 3. 제작방법 4. 부품 배치도 5. 부품 배선도 6. 회로 완성도 7. 555 타이머 IC를 이용한 구형파 발생기 |
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| 9. | |
기타 카운터 | 1. 기타 카운터 2. IC 카운터 3. 카운터의 응용 |
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HDL Behavioral Model | Behavioral Model | |
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| 10. | |
HDL Structual Model | Structual Model | |
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HDL Sequential Logic | HDL Sequential Logic | |
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| 11. | |
HDL MUX | MUX 카운터 |
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HDL FSM | 동기순서논리회로의 설계 | |
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| 12. | |
레지스터 | 1. 레지스터의 분류 2. 병렬입력-병렬출력 레지스터 3. 직렬입력-직렬출력 레지스터 4. 직렬입력-병렬출력 레지스터 5. 병렬입력-직렬출력 레지스터 6. 양방향 시프트 레지스터 |
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가산기 멀티플렉서 | 1. 가산기 2. 멀티플렉서 |
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| 13. | |
디코더 | 디코더 | |
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전기적 특성 | 게이트의 전기적 특성 | |
대구광역시 동구 동내로 64(동내동 1119) 우)41061
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